replace multiple instructions with macro SAVE_CONTEXT and RESTORE_CONTEXT
This commit is contained in:
@@ -12,6 +12,10 @@
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.global port_context_switch
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.global port_context_switch
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.global port_irq_context_switch
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.global port_irq_context_switch
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.extern k_curr_task
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||||||
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.extern k_next_task
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||||||
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||||||
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#include "riscv_encoding.h"
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#include "riscv_encoding.h"
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.text
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.text
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@@ -55,115 +59,188 @@ port_systick_pending_reset:
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csrc mip, t0
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csrc mip, t0
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ret
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ret
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||||||
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||||||
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||||||
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#define REGBYTES 4
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#define REGBYTES 4
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#define LOAD lw
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#define STORE sw
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.macro SAVE_CONTEXT
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.extern k_curr_task
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addi sp, sp, -32*REGBYTES
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||||||
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sw x1, 2*REGBYTES(sp)
|
||||||
|
sw x3, 3*REGBYTES(sp)
|
||||||
|
sw x4, 4*REGBYTES(sp)
|
||||||
|
sw x5, 5*REGBYTES(sp)
|
||||||
|
sw x6, 6*REGBYTES(sp)
|
||||||
|
sw x7, 7*REGBYTES(sp)
|
||||||
|
sw x8, 8*REGBYTES(sp)
|
||||||
|
sw x9, 9*REGBYTES(sp)
|
||||||
|
sw x10, 10*REGBYTES(sp)
|
||||||
|
sw x11, 11*REGBYTES(sp)
|
||||||
|
sw x12, 12*REGBYTES(sp)
|
||||||
|
sw x13, 13*REGBYTES(sp)
|
||||||
|
sw x14, 14*REGBYTES(sp)
|
||||||
|
sw x15, 15*REGBYTES(sp)
|
||||||
|
sw x16, 16*REGBYTES(sp)
|
||||||
|
sw x17, 17*REGBYTES(sp)
|
||||||
|
sw x18, 18*REGBYTES(sp)
|
||||||
|
sw x19, 19*REGBYTES(sp)
|
||||||
|
sw x20, 20*REGBYTES(sp)
|
||||||
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sw x21, 21*REGBYTES(sp)
|
||||||
|
sw x22, 22*REGBYTES(sp)
|
||||||
|
sw x23, 23*REGBYTES(sp)
|
||||||
|
sw x24, 24*REGBYTES(sp)
|
||||||
|
sw x25, 25*REGBYTES(sp)
|
||||||
|
sw x26, 26*REGBYTES(sp)
|
||||||
|
sw x27, 27*REGBYTES(sp)
|
||||||
|
sw x28, 28*REGBYTES(sp)
|
||||||
|
sw x29, 29*REGBYTES(sp)
|
||||||
|
sw x30, 30*REGBYTES(sp)
|
||||||
|
sw x31, 31*REGBYTES(sp)
|
||||||
|
.endm
|
||||||
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||||||
|
.macro RESTORE_CONTEXT
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||||||
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lw t0, 0*REGBYTES(sp)
|
||||||
|
csrw mepc, t0
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||||||
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||||||
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lw t0, 1*REGBYTES(sp)
|
||||||
|
csrw mstatus, t0
|
||||||
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|
||||||
|
lw x1, 2*REGBYTES(sp)
|
||||||
|
lw x3, 3*REGBYTES(sp)
|
||||||
|
lw x4, 4*REGBYTES(sp)
|
||||||
|
lw x5, 5*REGBYTES(sp)
|
||||||
|
lw x6, 6*REGBYTES(sp)
|
||||||
|
lw x7, 7*REGBYTES(sp)
|
||||||
|
lw x8, 8*REGBYTES(sp)
|
||||||
|
lw x9, 9*REGBYTES(sp)
|
||||||
|
lw x10, 10*REGBYTES(sp)
|
||||||
|
lw x11, 11*REGBYTES(sp)
|
||||||
|
lw x12, 12*REGBYTES(sp)
|
||||||
|
lw x13, 13*REGBYTES(sp)
|
||||||
|
lw x14, 14*REGBYTES(sp)
|
||||||
|
lw x15, 15*REGBYTES(sp)
|
||||||
|
lw x16, 16*REGBYTES(sp)
|
||||||
|
lw x17, 17*REGBYTES(sp)
|
||||||
|
lw x18, 18*REGBYTES(sp)
|
||||||
|
lw x19, 19*REGBYTES(sp)
|
||||||
|
lw x20, 20*REGBYTES(sp)
|
||||||
|
lw x21, 21*REGBYTES(sp)
|
||||||
|
lw x22, 22*REGBYTES(sp)
|
||||||
|
lw x23, 23*REGBYTES(sp)
|
||||||
|
lw x24, 24*REGBYTES(sp)
|
||||||
|
lw x25, 25*REGBYTES(sp)
|
||||||
|
lw x26, 26*REGBYTES(sp)
|
||||||
|
lw x27, 27*REGBYTES(sp)
|
||||||
|
lw x28, 28*REGBYTES(sp)
|
||||||
|
lw x29, 29*REGBYTES(sp)
|
||||||
|
lw x30, 30*REGBYTES(sp)
|
||||||
|
lw x31, 31*REGBYTES(sp)
|
||||||
|
|
||||||
|
addi sp, sp, 32*REGBYTES
|
||||||
|
.endm
|
||||||
|
|
||||||
|
.align 2
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||||||
|
context_switch_return:
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||||||
|
irq_context_return:
|
||||||
|
ret
|
||||||
|
|
||||||
|
.align 2
|
||||||
.type port_sched_start, %function
|
.type port_sched_start, %function
|
||||||
port_sched_start:
|
port_sched_start:
|
||||||
// enable timer interrupt
|
// enable timer interrupt
|
||||||
li t0, MIE_MTIE
|
li t0, MIE_MTIE
|
||||||
csrs mie, t0
|
csrs mie, t0
|
||||||
|
|
||||||
|
// load sp from k_curr_task->sp
|
||||||
la t0, k_curr_task // t0 = &k_curr_task
|
la t0, k_curr_task // t0 = &k_curr_task
|
||||||
LOAD t0, (t0) // t0 = &(k_curr_task->sp)
|
lw t0, (t0) // t0 = &(k_curr_task->sp)
|
||||||
LOAD sp, (t0) // k_curr_task->sp = sp
|
lw sp, (t0) // sp = k_curr_task->sp
|
||||||
|
|
||||||
// save sp
|
// save sp to stack
|
||||||
addi t1, sp, 32*REGBYTES
|
addi t1, sp, 32*REGBYTES
|
||||||
STORE t1, (t0)
|
sw t1, (t0)
|
||||||
|
|
||||||
LOAD t0, 0*REGBYTES(sp)
|
RESTORE_CONTEXT
|
||||||
csrw mepc, t0
|
|
||||||
|
|
||||||
LOAD t0, 1*REGBYTES(sp)
|
|
||||||
csrw mstatus, t0
|
|
||||||
|
|
||||||
LOAD x1, 2*REGBYTES(sp)
|
|
||||||
LOAD x3, 3*REGBYTES(sp)
|
|
||||||
LOAD x4, 4*REGBYTES(sp)
|
|
||||||
LOAD x5, 5*REGBYTES(sp)
|
|
||||||
LOAD x6, 6*REGBYTES(sp)
|
|
||||||
LOAD x7, 7*REGBYTES(sp)
|
|
||||||
LOAD x8, 8*REGBYTES(sp)
|
|
||||||
LOAD x9, 9*REGBYTES(sp)
|
|
||||||
LOAD x10, 10*REGBYTES(sp)
|
|
||||||
LOAD x11, 11*REGBYTES(sp)
|
|
||||||
LOAD x12, 12*REGBYTES(sp)
|
|
||||||
LOAD x13, 13*REGBYTES(sp)
|
|
||||||
LOAD x14, 14*REGBYTES(sp)
|
|
||||||
LOAD x15, 15*REGBYTES(sp)
|
|
||||||
LOAD x16, 16*REGBYTES(sp)
|
|
||||||
LOAD x17, 17*REGBYTES(sp)
|
|
||||||
LOAD x18, 18*REGBYTES(sp)
|
|
||||||
LOAD x19, 19*REGBYTES(sp)
|
|
||||||
LOAD x20, 20*REGBYTES(sp)
|
|
||||||
LOAD x21, 21*REGBYTES(sp)
|
|
||||||
LOAD x22, 22*REGBYTES(sp)
|
|
||||||
LOAD x23, 23*REGBYTES(sp)
|
|
||||||
LOAD x24, 24*REGBYTES(sp)
|
|
||||||
LOAD x25, 25*REGBYTES(sp)
|
|
||||||
LOAD x26, 26*REGBYTES(sp)
|
|
||||||
LOAD x27, 27*REGBYTES(sp)
|
|
||||||
LOAD x28, 28*REGBYTES(sp)
|
|
||||||
LOAD x29, 29*REGBYTES(sp)
|
|
||||||
LOAD x30, 30*REGBYTES(sp)
|
|
||||||
LOAD x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
addi sp, sp, 32*REGBYTES
|
|
||||||
|
|
||||||
mret
|
mret
|
||||||
|
|
||||||
|
|
||||||
|
.align 2
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||||||
|
.type port_context_switch, %function
|
||||||
|
port_context_switch:
|
||||||
|
SAVE_CONTEXT
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||||||
|
|
||||||
|
// return from port_context_switch as return from a function
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||||||
|
la t0, context_switch_return
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||||||
|
sw t0, 0*REGBYTES(sp)
|
||||||
|
|
||||||
|
csrr t0, mstatus
|
||||||
|
li t1, MSTATUS_MPP
|
||||||
|
or t0, t0, t1
|
||||||
|
sw t0, 1*REGBYTES(sp)
|
||||||
|
|
||||||
|
// save sp to k_curr_task.sp
|
||||||
|
la t0, k_curr_task // t0 = &k_curr_task
|
||||||
|
lw t1, (t0)
|
||||||
|
sw sp, (t1)
|
||||||
|
|
||||||
|
// switch task
|
||||||
|
// k_curr_task = k_next_task
|
||||||
|
la t1, k_next_task // t1 = &k_next_task
|
||||||
|
lw t1, (t1) // t1 = k_next_task
|
||||||
|
sw t1, (t0)
|
||||||
|
|
||||||
|
// load new task sp
|
||||||
|
lw sp, (t1)
|
||||||
|
|
||||||
|
RESTORE_CONTEXT
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||||||
|
|
||||||
|
mret
|
||||||
|
|
||||||
|
|
||||||
|
.align 2
|
||||||
|
.type port_irq_context_switch, %function
|
||||||
|
port_irq_context_switch:
|
||||||
|
SAVE_CONTEXT
|
||||||
|
|
||||||
|
|
||||||
|
la t0, irq_context_return
|
||||||
|
sw t0, 0*REGBYTES(sp)
|
||||||
|
|
||||||
|
li t0, MSTATUS_MPP
|
||||||
|
sw t0, 1*REGBYTES(sp)
|
||||||
|
|
||||||
|
// save sp to k_curr_task.sp
|
||||||
|
la t0, k_curr_task // t0 = &k_curr_task
|
||||||
|
lw t1, (t0)
|
||||||
|
sw sp, (t1)
|
||||||
|
|
||||||
|
// switch task
|
||||||
|
// k_curr_task = k_next_task
|
||||||
|
la t1, k_next_task // t1 = &k_next_task
|
||||||
|
lw t1, (t1) // t1 = k_next_task
|
||||||
|
sw t1, (t0)
|
||||||
|
|
||||||
|
// load new task sp
|
||||||
|
lw sp, (t1)
|
||||||
|
|
||||||
|
RESTORE_CONTEXT
|
||||||
|
|
||||||
|
mret
|
||||||
|
|
||||||
|
|
||||||
.align 2
|
.align 2
|
||||||
.global machine_trap_entry
|
.global machine_trap_entry
|
||||||
machine_trap_entry:
|
machine_trap_entry:
|
||||||
addi sp, sp, -32*REGBYTES
|
SAVE_CONTEXT
|
||||||
STORE x1, 2*REGBYTES(sp)
|
|
||||||
STORE x3, 3*REGBYTES(sp)
|
csrr t0, mepc
|
||||||
STORE x4, 4*REGBYTES(sp)
|
sw t0, 0*REGBYTES(sp)
|
||||||
STORE x5, 5*REGBYTES(sp)
|
|
||||||
STORE x6, 6*REGBYTES(sp)
|
|
||||||
STORE x7, 7*REGBYTES(sp)
|
|
||||||
STORE x8, 8*REGBYTES(sp)
|
|
||||||
STORE x9, 9*REGBYTES(sp)
|
|
||||||
STORE x10, 10*REGBYTES(sp)
|
|
||||||
STORE x11, 11*REGBYTES(sp)
|
|
||||||
STORE x12, 12*REGBYTES(sp)
|
|
||||||
STORE x13, 13*REGBYTES(sp)
|
|
||||||
STORE x14, 14*REGBYTES(sp)
|
|
||||||
STORE x15, 15*REGBYTES(sp)
|
|
||||||
STORE x16, 16*REGBYTES(sp)
|
|
||||||
STORE x17, 17*REGBYTES(sp)
|
|
||||||
STORE x18, 18*REGBYTES(sp)
|
|
||||||
STORE x19, 19*REGBYTES(sp)
|
|
||||||
STORE x20, 20*REGBYTES(sp)
|
|
||||||
STORE x21, 21*REGBYTES(sp)
|
|
||||||
STORE x22, 22*REGBYTES(sp)
|
|
||||||
STORE x23, 23*REGBYTES(sp)
|
|
||||||
STORE x24, 24*REGBYTES(sp)
|
|
||||||
STORE x25, 25*REGBYTES(sp)
|
|
||||||
STORE x26, 26*REGBYTES(sp)
|
|
||||||
STORE x27, 27*REGBYTES(sp)
|
|
||||||
STORE x28, 28*REGBYTES(sp)
|
|
||||||
STORE x29, 29*REGBYTES(sp)
|
|
||||||
STORE x30, 30*REGBYTES(sp)
|
|
||||||
STORE x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
#if 1
|
|
||||||
//li t0, MSTATUS_MPP | MSTATUS_MPIE // acutally MPIE is not need
|
|
||||||
csrr t0, mstatus
|
csrr t0, mstatus
|
||||||
STORE t0, 1*REGBYTES(sp)
|
sw t0, 1*REGBYTES(sp)
|
||||||
|
|
||||||
csrr t0, mepc // just save information for handler
|
|
||||||
STORE t0, 0*REGBYTES(sp)
|
|
||||||
|
|
||||||
|
|
||||||
// save sp to k_curr_task.sp
|
// save sp to k_curr_task.sp
|
||||||
la t0, k_curr_task // t0 = &k_curr_task
|
la t0, k_curr_task // t0 = &k_curr_task
|
||||||
LOAD t1, (t0)
|
lw t1, (t0)
|
||||||
STORE sp, (t1)
|
sw sp, (t1)
|
||||||
|
|
||||||
csrr a0, mcause
|
csrr a0, mcause
|
||||||
mv a1, sp
|
mv a1, sp
|
||||||
@@ -175,257 +252,7 @@ irq:
|
|||||||
srli a0, a0, 1
|
srli a0, a0, 1
|
||||||
call cpu_irq_entry
|
call cpu_irq_entry
|
||||||
restore:
|
restore:
|
||||||
LOAD t0, 0*REGBYTES(sp)
|
RESTORE_CONTEXT
|
||||||
csrw mepc, t0
|
|
||||||
|
|
||||||
LOAD t0, 1*REGBYTES(sp)
|
|
||||||
csrw mstatus, t0
|
|
||||||
#else
|
|
||||||
// for debug timer interrupt only
|
|
||||||
csrr a0, mcause
|
|
||||||
slli a0, a0, 1
|
|
||||||
srli a0, a0, 1
|
|
||||||
call cpu_irq_entry
|
|
||||||
#endif
|
|
||||||
LOAD x1, 2*REGBYTES(sp)
|
|
||||||
LOAD x3, 3*REGBYTES(sp)
|
|
||||||
LOAD x4, 4*REGBYTES(sp)
|
|
||||||
LOAD x5, 5*REGBYTES(sp)
|
|
||||||
LOAD x6, 6*REGBYTES(sp)
|
|
||||||
LOAD x7, 7*REGBYTES(sp)
|
|
||||||
LOAD x8, 8*REGBYTES(sp)
|
|
||||||
LOAD x9, 9*REGBYTES(sp)
|
|
||||||
LOAD x10, 10*REGBYTES(sp)
|
|
||||||
LOAD x11, 11*REGBYTES(sp)
|
|
||||||
LOAD x12, 12*REGBYTES(sp)
|
|
||||||
LOAD x13, 13*REGBYTES(sp)
|
|
||||||
LOAD x14, 14*REGBYTES(sp)
|
|
||||||
LOAD x15, 15*REGBYTES(sp)
|
|
||||||
LOAD x16, 16*REGBYTES(sp)
|
|
||||||
LOAD x17, 17*REGBYTES(sp)
|
|
||||||
LOAD x18, 18*REGBYTES(sp)
|
|
||||||
LOAD x19, 19*REGBYTES(sp)
|
|
||||||
LOAD x20, 20*REGBYTES(sp)
|
|
||||||
LOAD x21, 21*REGBYTES(sp)
|
|
||||||
LOAD x22, 22*REGBYTES(sp)
|
|
||||||
LOAD x23, 23*REGBYTES(sp)
|
|
||||||
LOAD x24, 24*REGBYTES(sp)
|
|
||||||
LOAD x25, 25*REGBYTES(sp)
|
|
||||||
LOAD x26, 26*REGBYTES(sp)
|
|
||||||
LOAD x27, 27*REGBYTES(sp)
|
|
||||||
LOAD x28, 28*REGBYTES(sp)
|
|
||||||
LOAD x29, 29*REGBYTES(sp)
|
|
||||||
LOAD x30, 30*REGBYTES(sp)
|
|
||||||
LOAD x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
addi sp, sp, 32*REGBYTES
|
|
||||||
|
|
||||||
mret
|
mret
|
||||||
|
|
||||||
|
|
||||||
.align 2
|
|
||||||
.type port_context_switch, %function
|
|
||||||
port_context_switch:
|
|
||||||
nop
|
|
||||||
nop
|
|
||||||
addi sp, sp, -32*REGBYTES
|
|
||||||
STORE x1, 2*REGBYTES(sp)
|
|
||||||
STORE x3, 3*REGBYTES(sp)
|
|
||||||
STORE x4, 4*REGBYTES(sp)
|
|
||||||
STORE x5, 5*REGBYTES(sp)
|
|
||||||
STORE x6, 6*REGBYTES(sp)
|
|
||||||
STORE x7, 7*REGBYTES(sp)
|
|
||||||
STORE x8, 8*REGBYTES(sp)
|
|
||||||
STORE x9, 9*REGBYTES(sp)
|
|
||||||
STORE x10, 10*REGBYTES(sp)
|
|
||||||
STORE x11, 11*REGBYTES(sp)
|
|
||||||
STORE x12, 12*REGBYTES(sp)
|
|
||||||
STORE x13, 13*REGBYTES(sp)
|
|
||||||
STORE x14, 14*REGBYTES(sp)
|
|
||||||
STORE x15, 15*REGBYTES(sp)
|
|
||||||
STORE x16, 16*REGBYTES(sp)
|
|
||||||
STORE x17, 17*REGBYTES(sp)
|
|
||||||
STORE x18, 18*REGBYTES(sp)
|
|
||||||
STORE x19, 19*REGBYTES(sp)
|
|
||||||
STORE x20, 20*REGBYTES(sp)
|
|
||||||
STORE x21, 21*REGBYTES(sp)
|
|
||||||
STORE x22, 22*REGBYTES(sp)
|
|
||||||
STORE x23, 23*REGBYTES(sp)
|
|
||||||
STORE x24, 24*REGBYTES(sp)
|
|
||||||
STORE x25, 25*REGBYTES(sp)
|
|
||||||
STORE x26, 26*REGBYTES(sp)
|
|
||||||
STORE x27, 27*REGBYTES(sp)
|
|
||||||
STORE x28, 28*REGBYTES(sp)
|
|
||||||
STORE x29, 29*REGBYTES(sp)
|
|
||||||
STORE x30, 30*REGBYTES(sp)
|
|
||||||
STORE x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
li t0, MSTATUS_MPP // force use machine mode
|
|
||||||
csrr t1, mstatus
|
|
||||||
and t1, t1, MSTATUS_MIE
|
|
||||||
beqz t1, save_mstatus
|
|
||||||
or t0, t0, MSTATUS_MPIE
|
|
||||||
save_mstatus:
|
|
||||||
STORE t0, 1*REGBYTES(sp)
|
|
||||||
la t0, port_context_switch_return // just save information for handler
|
|
||||||
STORE t0, 0*REGBYTES(sp)
|
|
||||||
|
|
||||||
// save sp to k_curr_task.sp
|
|
||||||
la t0, k_curr_task // t0 = &k_curr_task
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|
||||||
LOAD t1, (t0)
|
|
||||||
STORE sp, (t1)
|
|
||||||
|
|
||||||
// k_curr_task = k_next_task
|
|
||||||
la t1, k_next_task // t1 = &k_next_task
|
|
||||||
LOAD t1, (t1) // t1 = k_next_task
|
|
||||||
STORE t1, (t0)
|
|
||||||
|
|
||||||
// load sp from k_next_task.sp
|
|
||||||
LOAD sp, (t1)
|
|
||||||
|
|
||||||
LOAD t0, 0*REGBYTES(sp)
|
|
||||||
csrw mepc, t0
|
|
||||||
|
|
||||||
LOAD t0, 1*REGBYTES(sp)
|
|
||||||
csrw mstatus, t0
|
|
||||||
|
|
||||||
LOAD x1, 2*REGBYTES(sp)
|
|
||||||
LOAD x3, 3*REGBYTES(sp)
|
|
||||||
LOAD x4, 4*REGBYTES(sp)
|
|
||||||
LOAD x5, 5*REGBYTES(sp)
|
|
||||||
LOAD x6, 6*REGBYTES(sp)
|
|
||||||
LOAD x7, 7*REGBYTES(sp)
|
|
||||||
LOAD x8, 8*REGBYTES(sp)
|
|
||||||
LOAD x9, 9*REGBYTES(sp)
|
|
||||||
LOAD x10, 10*REGBYTES(sp)
|
|
||||||
LOAD x11, 11*REGBYTES(sp)
|
|
||||||
LOAD x12, 12*REGBYTES(sp)
|
|
||||||
LOAD x13, 13*REGBYTES(sp)
|
|
||||||
LOAD x14, 14*REGBYTES(sp)
|
|
||||||
LOAD x15, 15*REGBYTES(sp)
|
|
||||||
LOAD x16, 16*REGBYTES(sp)
|
|
||||||
LOAD x17, 17*REGBYTES(sp)
|
|
||||||
LOAD x18, 18*REGBYTES(sp)
|
|
||||||
LOAD x19, 19*REGBYTES(sp)
|
|
||||||
LOAD x20, 20*REGBYTES(sp)
|
|
||||||
LOAD x21, 21*REGBYTES(sp)
|
|
||||||
LOAD x22, 22*REGBYTES(sp)
|
|
||||||
LOAD x23, 23*REGBYTES(sp)
|
|
||||||
LOAD x24, 24*REGBYTES(sp)
|
|
||||||
LOAD x25, 25*REGBYTES(sp)
|
|
||||||
LOAD x26, 26*REGBYTES(sp)
|
|
||||||
LOAD x27, 27*REGBYTES(sp)
|
|
||||||
LOAD x28, 28*REGBYTES(sp)
|
|
||||||
LOAD x29, 29*REGBYTES(sp)
|
|
||||||
LOAD x30, 30*REGBYTES(sp)
|
|
||||||
LOAD x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
addi sp, sp, 32*REGBYTES
|
|
||||||
|
|
||||||
mret
|
|
||||||
|
|
||||||
.align 2
|
|
||||||
port_context_switch_return:
|
|
||||||
ret
|
|
||||||
|
|
||||||
|
|
||||||
.align 2
|
|
||||||
.type port_irq_context_switch, %function
|
|
||||||
port_irq_context_switch:
|
|
||||||
addi sp, sp, -32*REGBYTES
|
|
||||||
STORE x1, 2*REGBYTES(sp)
|
|
||||||
STORE x3, 3*REGBYTES(sp)
|
|
||||||
STORE x4, 4*REGBYTES(sp)
|
|
||||||
STORE x5, 5*REGBYTES(sp)
|
|
||||||
STORE x6, 6*REGBYTES(sp)
|
|
||||||
STORE x7, 7*REGBYTES(sp)
|
|
||||||
STORE x8, 8*REGBYTES(sp)
|
|
||||||
STORE x9, 9*REGBYTES(sp)
|
|
||||||
STORE x10, 10*REGBYTES(sp)
|
|
||||||
STORE x11, 11*REGBYTES(sp)
|
|
||||||
STORE x12, 12*REGBYTES(sp)
|
|
||||||
STORE x13, 13*REGBYTES(sp)
|
|
||||||
STORE x14, 14*REGBYTES(sp)
|
|
||||||
STORE x15, 15*REGBYTES(sp)
|
|
||||||
STORE x16, 16*REGBYTES(sp)
|
|
||||||
STORE x17, 17*REGBYTES(sp)
|
|
||||||
STORE x18, 18*REGBYTES(sp)
|
|
||||||
STORE x19, 19*REGBYTES(sp)
|
|
||||||
STORE x20, 20*REGBYTES(sp)
|
|
||||||
STORE x21, 21*REGBYTES(sp)
|
|
||||||
STORE x22, 22*REGBYTES(sp)
|
|
||||||
STORE x23, 23*REGBYTES(sp)
|
|
||||||
STORE x24, 24*REGBYTES(sp)
|
|
||||||
STORE x25, 25*REGBYTES(sp)
|
|
||||||
STORE x26, 26*REGBYTES(sp)
|
|
||||||
STORE x27, 27*REGBYTES(sp)
|
|
||||||
STORE x28, 28*REGBYTES(sp)
|
|
||||||
STORE x29, 29*REGBYTES(sp)
|
|
||||||
STORE x30, 30*REGBYTES(sp)
|
|
||||||
STORE x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
li t0, MSTATUS_MPP
|
|
||||||
STORE t0, 1*REGBYTES(sp)
|
|
||||||
la t0, irq_context_return
|
|
||||||
STORE t0, 0*REGBYTES(sp)
|
|
||||||
|
|
||||||
// save sp to k_curr_task.sp
|
|
||||||
la t0, k_curr_task // t0 = &k_curr_task
|
|
||||||
LOAD t1, (t0)
|
|
||||||
STORE sp, (t1)
|
|
||||||
|
|
||||||
// k_curr_task = k_next_task
|
|
||||||
la t1, k_next_task // t1 = &k_next_task
|
|
||||||
LOAD t1, (t1) // t1 = k_next_task
|
|
||||||
STORE t1, (t0)
|
|
||||||
|
|
||||||
// load sp from k_next_task.sp
|
|
||||||
LOAD sp, (t1)
|
|
||||||
|
|
||||||
LOAD t0, 1*REGBYTES(sp)
|
|
||||||
csrw mstatus, t0
|
|
||||||
|
|
||||||
LOAD t0, 0*REGBYTES(sp)
|
|
||||||
csrw mepc, t0
|
|
||||||
|
|
||||||
LOAD x1, 2*REGBYTES(sp)
|
|
||||||
LOAD x3, 3*REGBYTES(sp)
|
|
||||||
LOAD x4, 4*REGBYTES(sp)
|
|
||||||
LOAD x5, 5*REGBYTES(sp)
|
|
||||||
LOAD x6, 6*REGBYTES(sp)
|
|
||||||
LOAD x7, 7*REGBYTES(sp)
|
|
||||||
LOAD x8, 8*REGBYTES(sp)
|
|
||||||
LOAD x9, 9*REGBYTES(sp)
|
|
||||||
LOAD x10, 10*REGBYTES(sp)
|
|
||||||
LOAD x11, 11*REGBYTES(sp)
|
|
||||||
LOAD x12, 12*REGBYTES(sp)
|
|
||||||
LOAD x13, 13*REGBYTES(sp)
|
|
||||||
LOAD x14, 14*REGBYTES(sp)
|
|
||||||
LOAD x15, 15*REGBYTES(sp)
|
|
||||||
LOAD x16, 16*REGBYTES(sp)
|
|
||||||
LOAD x17, 17*REGBYTES(sp)
|
|
||||||
LOAD x18, 18*REGBYTES(sp)
|
|
||||||
LOAD x19, 19*REGBYTES(sp)
|
|
||||||
LOAD x20, 20*REGBYTES(sp)
|
|
||||||
LOAD x21, 21*REGBYTES(sp)
|
|
||||||
LOAD x22, 22*REGBYTES(sp)
|
|
||||||
LOAD x23, 23*REGBYTES(sp)
|
|
||||||
LOAD x24, 24*REGBYTES(sp)
|
|
||||||
LOAD x25, 25*REGBYTES(sp)
|
|
||||||
LOAD x26, 26*REGBYTES(sp)
|
|
||||||
LOAD x27, 27*REGBYTES(sp)
|
|
||||||
LOAD x28, 28*REGBYTES(sp)
|
|
||||||
LOAD x29, 29*REGBYTES(sp)
|
|
||||||
LOAD x30, 30*REGBYTES(sp)
|
|
||||||
LOAD x31, 31*REGBYTES(sp)
|
|
||||||
|
|
||||||
|
|
||||||
addi sp, sp, 32*REGBYTES
|
|
||||||
|
|
||||||
mret
|
|
||||||
|
|
||||||
|
|
||||||
irq_context_return:
|
|
||||||
ret
|
|
||||||
|
|
||||||
|
|
||||||
|
@@ -125,16 +125,18 @@
|
|||||||
|
|
||||||
<option IS_BUILTIN_EMPTY="false" IS_VALUE_EMPTY="false" id="ilg.gnumcueclipse.managedbuild.cross.riscv.option.c.compiler.include.paths.293419375" name="Include paths (-I)" superClass="ilg.gnumcueclipse.managedbuild.cross.riscv.option.c.compiler.include.paths" useByScannerDiscovery="true" valueType="includePath">
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<option IS_BUILTIN_EMPTY="false" IS_VALUE_EMPTY="false" id="ilg.gnumcueclipse.managedbuild.cross.riscv.option.c.compiler.include.paths.293419375" name="Include paths (-I)" superClass="ilg.gnumcueclipse.managedbuild.cross.riscv.option.c.compiler.include.paths" useByScannerDiscovery="true" valueType="includePath">
|
||||||
|
|
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<listOptionValue builtIn="false" value=""${workspace_loc:/hello_world/TencentOS_tiny/arch/risc-v/rv32i}""/>
|
|
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|
|
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|
|
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|
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|
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|
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|
|
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|
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|
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|
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|
|
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|
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|
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|
|
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|
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|
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|
|
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</option>
|
</option>
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<inputType id="ilg.gnumcueclipse.managedbuild.cross.riscv.tool.c.compiler.input.905374687" superClass="ilg.gnumcueclipse.managedbuild.cross.riscv.tool.c.compiler.input"/>
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<inputType id="ilg.gnumcueclipse.managedbuild.cross.riscv.tool.c.compiler.input.905374687" superClass="ilg.gnumcueclipse.managedbuild.cross.riscv.tool.c.compiler.input"/>
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@@ -211,9 +213,7 @@
|
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|
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|
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|
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|
|
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@@ -369,9 +369,7 @@
|
|||||||
|
|
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<sourceEntries>
|
<sourceEntries>
|
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|
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<entry excluding="Src" flags="VALUE_WORKSPACE_PATH|RESOLVED" kind="sourcePath" name=""/>
|
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|
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|
|
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<entry flags="VALUE_WORKSPACE_PATH|RESOLVED" kind="sourcePath" name="Src"/>
|
|
||||||
|
|
||||||
</sourceEntries>
|
</sourceEntries>
|
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|
|
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|
@@ -24,6 +24,21 @@
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</natures>
|
</natures>
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|
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|
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|
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|
<link>
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<name>TencentOS_tiny</name>
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|
<type>2</type>
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@@ -11,7 +11,7 @@
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|
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