3d9d6198c8
How To Run:
see TencentOS-tiny\board\ALPHA_I.MX_emmc_256ddr\README.md
TODO Next:
1. VFP support
2. fault diagnosis support
3. qemu vexpress ca9 support
4. raspberry pi support
5. SMP support
127 lines
5.1 KiB
C
127 lines
5.1 KiB
C
#include "bsp_clk.h"
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/***************************************************************
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Copyright © zuozhongkai Co., Ltd. 1998-2019. All rights reserved.
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文件名 : bsp_clk.c
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作者 : 左忠凯
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版本 : V1.0
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描述 : 系统时钟驱动。
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其他 : 无
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论坛 : www.openedv.com
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日志 : 初版V1.0 2019/1/3 左忠凯创建
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V2.0 2019/1/3 左忠凯修改
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添加了函数imx6u_clkinit()，完成I.MX6U的系统时钟初始化
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V2.1 2019/3/1 左忠凯修改
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添加UART时钟源配置代码
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***************************************************************/
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/*
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* @description : 使能I.MX6U所有外设时钟
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* @param : 无
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* @return : 无
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*/
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void clk_enable(void)
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{
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CCM->CCGR0 = 0XFFFFFFFF;
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CCM->CCGR1 = 0XFFFFFFFF;
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CCM->CCGR2 = 0XFFFFFFFF;
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CCM->CCGR3 = 0XFFFFFFFF;
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CCM->CCGR4 = 0XFFFFFFFF;
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CCM->CCGR5 = 0XFFFFFFFF;
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CCM->CCGR6 = 0XFFFFFFFF;
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}
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/*
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* @description : 初始化系统时钟，设置系统时钟为528Mhz，并且设置PLL2和PLL3各个
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PFD时钟,所有的时钟频率均按照I.MX6U官方手册推荐的值.
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* @param : 无
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* @return : 无
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*/
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void imx6u_clkinit(void)
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{
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unsigned int reg = 0;
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/* 1、设置ARM内核时钟为528MHz */
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/* 1.1、判断当前ARM内核是使用的那个时钟源启动的，正常情况下ARM内核是由pll1_sw_clk驱动的，而
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* pll1_sw_clk有两个来源：pll1_main_clk和tep_clk(参考手册648页)。
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* 如果我们要让ARM内核跑到528M的话那必须选择pll1_main_clk作为pll1的时钟源。
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* 如果我们要修改pll1_main_clk时钟的话就必须先将pll1_sw_clk从pll1_main_clk切换到step_clk,
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* 当修改完pll1_main_clk以后在将pll1_sw_clk切换回pll1_main_clk。而step_clk的时钟源可以选择
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* 板子上的24MHz晶振。
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*/
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if((((CCM->CCSR) >> 2) & 0x1 ) == 0) /* 当前pll1_sw_clk使用的pll1_main_clk*/
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{
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CCM->CCSR &= ~(1 << 8); /* 配置step_clk时钟源为24MH OSC */
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CCM->CCSR |= (1 << 2); /* 配置pll1_sw_clk时钟源为step_clk */
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}
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/* 1.2、设置pll1_main_clk为1056MHz,也就是528*2=1056MHZ,
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* 因为pll1_sw_clk进ARM内核的时候会被二分频！
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* 配置CCM_ANLOG->PLL_ARM寄存器
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* bit13: 1 使能时钟输出
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* bit[6:0]: 88, 由公式：Fout = Fin * div_select / 2.0，1056=24*div_select/2.0,
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* 得出：div_select= 88
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*/
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CCM_ANALOG->PLL_ARM = (1 << 13) | ((88 << 0) & 0X7F); /* 配置pll1_main_clk=1056MHz */
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CCM->CCSR &= ~(1 << 2); /* 将pll_sw_clk时钟重新切换回pll1_main_clk */
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CCM->CACRR = 1; /* ARM内核时钟为pll1_sw_clk/2=1056/2=528Mhz */
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/* 2、设置PLL2(SYS PLL)各个PFD */
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reg = CCM_ANALOG->PFD_528;
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reg &= ~(0X3F3F3F3F); /* 清除原来的设置 */
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reg |= 32<<24; /* PLL2_PFD3=528*18/32=297Mhz */
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reg |= 24<<16; /* PLL2_PFD2=528*18/24=396Mhz(DDR使用的时钟，最大400Mhz) */
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reg |= 16<<8; /* PLL2_PFD1=528*18/16=594Mhz */
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reg |= 27<<0; /* PLL2_PFD0=528*18/27=352Mhz */
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CCM_ANALOG->PFD_528=reg; /* 设置PLL2_PFD0~3 */
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/* 3、设置PLL3(USB1)各个PFD */
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reg = 0; /* 清零 */
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reg = CCM_ANALOG->PFD_480;
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reg &= ~(0X3F3F3F3F); /* 清除原来的设置 */
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reg |= 19<<24; /* PLL3_PFD3=480*18/19=454.74Mhz */
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reg |= 17<<16; /* PLL3_PFD2=480*18/17=508.24Mhz */
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reg |= 16<<8; /* PLL3_PFD1=480*18/16=540Mhz */
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reg |= 12<<0; /* PLL3_PFD0=480*18/12=720Mhz */
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CCM_ANALOG->PFD_480=reg; /* 设置PLL3_PFD0~3 */
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/* 4、设置AHB时钟 最小6Mhz， 最大132Mhz (boot rom自动设置好了可以不用设置)*/
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CCM->CBCMR &= ~(3 << 18); /* 清除设置*/
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CCM->CBCMR |= (1 << 18); /* pre_periph_clk=PLL2_PFD2=396MHz */
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CCM->CBCDR &= ~(1 << 25); /* periph_clk=pre_periph_clk=396MHz */
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while(CCM->CDHIPR & (1 << 5));/* 等待握手完成 */
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/* 修改AHB_PODF位的时候需要先禁止AHB_CLK_ROOT的输出，但是
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* 我没有找到关闭AHB_CLK_ROOT输出的的寄存器，所以就没法设置。
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* 下面设置AHB_PODF的代码仅供学习参考不能直接拿来使用！！
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* 内部boot rom将AHB_PODF设置为了3分频，即使我们不设置AHB_PODF，
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* AHB_ROOT_CLK也依旧等于396/3=132Mhz。
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*/
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#if 0
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/* 要先关闭AHB_ROOT_CLK输出，否则时钟设置会出错 */
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CCM->CBCDR &= ~(7 << 10); /* CBCDR的AHB_PODF清零 */
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CCM->CBCDR |= 2 << 10; /* AHB_PODF 3分频，AHB_CLK_ROOT=132MHz */
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while(CCM->CDHIPR & (1 << 1));/
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* 等待握手完成 */
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#endif
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/* 5、设置IPG_CLK_ROOT最小3Mhz，最大66Mhz (boot rom自动设置好了可以不用设置)*/
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CCM->CBCDR &= ~(3 << 8); /* CBCDR的IPG_PODF清零 */
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CCM->CBCDR |= 1 << 8; /* IPG_PODF 2分频，IPG_CLK_ROOT=66MHz */
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/* 6、设置PERCLK_CLK_ROOT时钟 */
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CCM->CSCMR1 &= ~(1 << 6); /* PERCLK_CLK_ROOT时钟源为IPG */
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CCM->CSCMR1 &= ~(7 << 0); /* PERCLK_PODF位清零，即1分频 */
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/* 设置UART时钟源频率为80M */
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CCM->CSCDR1 &= ~(1 << 6); /* UART时钟源为pll3_80m */
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CCM->CSCDR1 &= ~0X3F; /* UART时钟1分频 */
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#if 0
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||
/* 设置ECSPI时钟源为60Mhz */
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CCM->CSCDR2 &= ~(1 << 18); /* ECSPI时钟源为pll3_60m*/
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||
CCM->CSCDR2 &= ~(0X3F << 19); /* ECSPI 1分频 */
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#endif
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}
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